onur
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3.3 KiB
Systemverilog
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Systemverilog
// Generated by CIRCT firtool-1.151.0
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module TLAsyncCrossingSource_a9d32s1k1z2u(
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input clock,
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reset,
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output auto_in_a_ready,
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input auto_in_a_valid,
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input [2:0] auto_in_a_bits_opcode,
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input [8:0] auto_in_a_bits_address,
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input [31:0] auto_in_a_bits_data,
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input auto_in_d_ready,
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output auto_in_d_valid,
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output [2:0] auto_in_d_bits_opcode,
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output auto_in_d_bits_denied,
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output [31:0] auto_in_d_bits_data,
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output auto_in_d_bits_corrupt,
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output [2:0] auto_out_a_mem_0_opcode,
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output [8:0] auto_out_a_mem_0_address,
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output [31:0] auto_out_a_mem_0_data,
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input auto_out_a_ridx,
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output auto_out_a_widx,
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input auto_out_a_safe_ridx_valid,
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output auto_out_a_safe_widx_valid,
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auto_out_a_safe_source_reset_n,
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input auto_out_a_safe_sink_reset_n,
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input [2:0] auto_out_d_mem_0_opcode,
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input [1:0] auto_out_d_mem_0_size,
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input auto_out_d_mem_0_source,
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input [31:0] auto_out_d_mem_0_data,
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output auto_out_d_ridx,
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input auto_out_d_widx,
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output auto_out_d_safe_ridx_valid,
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input auto_out_d_safe_widx_valid,
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auto_out_d_safe_source_reset_n,
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output auto_out_d_safe_sink_reset_n
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);
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AsyncQueueSource_TLBundleA_a9d32s1k1z2u nodeOut_a_source (
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.clock (clock),
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.reset (reset),
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.io_enq_ready (auto_in_a_ready),
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.io_enq_valid (auto_in_a_valid),
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.io_enq_bits_opcode (auto_in_a_bits_opcode),
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.io_enq_bits_address (auto_in_a_bits_address),
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.io_enq_bits_data (auto_in_a_bits_data),
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.io_async_mem_0_opcode (auto_out_a_mem_0_opcode),
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.io_async_mem_0_address (auto_out_a_mem_0_address),
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.io_async_mem_0_data (auto_out_a_mem_0_data),
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.io_async_ridx (auto_out_a_ridx),
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.io_async_widx (auto_out_a_widx),
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.io_async_safe_ridx_valid (auto_out_a_safe_ridx_valid),
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.io_async_safe_widx_valid (auto_out_a_safe_widx_valid),
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.io_async_safe_source_reset_n (auto_out_a_safe_source_reset_n),
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.io_async_safe_sink_reset_n (auto_out_a_safe_sink_reset_n)
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);
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AsyncQueueSink_TLBundleD_a9d32s1k1z2u nodeIn_d_sink (
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.clock (clock),
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.reset (reset),
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.io_deq_ready (auto_in_d_ready),
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.io_deq_valid (auto_in_d_valid),
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.io_deq_bits_opcode (auto_in_d_bits_opcode),
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.io_deq_bits_denied (auto_in_d_bits_denied),
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.io_deq_bits_data (auto_in_d_bits_data),
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.io_deq_bits_corrupt (auto_in_d_bits_corrupt),
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.io_async_mem_0_opcode (auto_out_d_mem_0_opcode),
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.io_async_mem_0_size (auto_out_d_mem_0_size),
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.io_async_mem_0_source (auto_out_d_mem_0_source),
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.io_async_mem_0_data (auto_out_d_mem_0_data),
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.io_async_ridx (auto_out_d_ridx),
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.io_async_widx (auto_out_d_widx),
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.io_async_safe_ridx_valid (auto_out_d_safe_ridx_valid),
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.io_async_safe_widx_valid (auto_out_d_safe_widx_valid),
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.io_async_safe_source_reset_n (auto_out_d_safe_source_reset_n),
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.io_async_safe_sink_reset_n (auto_out_d_safe_sink_reset_n)
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);
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endmodule
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