onur
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Systemverilog
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Systemverilog
// Generated by CIRCT firtool-1.151.0
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module IntXbar_i2_o1(
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input auto_anon_in_1_0,
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auto_anon_in_0_0,
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auto_anon_in_0_1,
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auto_anon_in_0_2,
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auto_anon_in_0_3,
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auto_anon_in_0_4,
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auto_anon_in_0_5,
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auto_anon_in_0_6,
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auto_anon_in_0_7,
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auto_anon_in_0_8,
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auto_anon_in_0_9,
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output auto_anon_out_0,
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auto_anon_out_1,
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auto_anon_out_2,
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auto_anon_out_3,
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auto_anon_out_4,
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auto_anon_out_5,
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auto_anon_out_6,
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auto_anon_out_7,
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auto_anon_out_8,
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auto_anon_out_9,
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auto_anon_out_10
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);
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assign auto_anon_out_0 = auto_anon_in_0_0;
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assign auto_anon_out_1 = auto_anon_in_0_1;
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assign auto_anon_out_2 = auto_anon_in_0_2;
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assign auto_anon_out_3 = auto_anon_in_0_3;
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assign auto_anon_out_4 = auto_anon_in_0_4;
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assign auto_anon_out_5 = auto_anon_in_0_5;
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assign auto_anon_out_6 = auto_anon_in_0_6;
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assign auto_anon_out_7 = auto_anon_in_0_7;
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assign auto_anon_out_8 = auto_anon_in_0_8;
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assign auto_anon_out_9 = auto_anon_in_0_9;
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assign auto_anon_out_10 = auto_anon_in_1_0;
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endmodule
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